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判断题

同步时序逻辑电路中的存储元件可以是任意类型的触发器。

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判断题

在组合逻辑电路中,由竞争产生的险象是一种瞬间的错误现象。

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判断题

组合逻辑电路中的竞争是由逻辑设计错误引起的。

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对于多输出组合逻辑电路,仅将各单个输出函数化为最简表达式,不一定能使整体达到最简。

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判断题

设计包含无关条件的组合逻辑电路时,利用无关最小项的随意性有利于输出函数化简。

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判断题

采用主从式结构,或者增加维持阻塞功能,都可解决触发器的“空翻”现象。

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判断题

对时钟控制触发器而言,时钟脉冲确定触发器状态何时转换,输入信号确定触发器状态如何转换。

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判断题

同一逻辑电路用正逻辑描述出的逻辑功能和用负逻辑描述出的逻辑功能应该一致。

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三态门有三种输出状态(即输出高电平、输出低电平和高阻状态),分别代表三种不同的逻辑值。

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判断题

门电路带同类门数量的多少称为门的扇出数。

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