单项选择题X 纠错

时序逻辑电路的置数端有效，则电路为（）状态。

A、计数
B、并行置数
C、置1
D、清0

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单项选择题

JK触发器，当JK为（）时，触发器处于置1状态。

A、00
B、01
C、10
D、11

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单项选择题

由或非门组成的基本RS触发器，当RS为（）时，触发器处于不定状态。

A、00
B、01
C、10
D、11

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单项选择题

集成或非门被封锁，应检查其多余引脚是否接了（）

A、悬空
B、高电平
C、低电平
D、并接

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单项选择题

集成或非门的多余引脚（）时，或非门被封锁。

A、悬空
B、接高电平
C、接低电平
D、并接

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单项选择题

时序逻辑电路的计数器取相应进制数少一经相应门电路送到（）端。

A、异步清零端
B、同步清零端
C、异步置数端
D、同步置数端

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单项选择题

下列不属于组合逻辑电路的加法器为（）。

A、半加器
B、全加器
C、多位加法器
D、计数器

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单项选择题

下列不能用于构成组合逻辑电路的是（）。

A、与非门
B、或非门
C、异或门
D、触发器

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单项选择题

时序逻辑电路的计数器直接取相应进制数经相应门电路送到（）端。

A、异步清零端
B、同步清零端
C、异步置数端
D、同步置数端

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单项选择题

时序逻辑电路的计数控制端无效，则电路处于（）状态。

A、计数
B、保持
C、置1
D、置0

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单项选择题

JK触发器，当JK为（）时，触发器处于翻转状态。

A、00
B、01
C、10
D、11

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