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判断题

TLB是页表转换查找缓冲器。

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素数模法是避免存储体冲突的一种方法。

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写操作流水化会减小cache的命中时间。

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采用容量小、结构简单的Cache会减小cache的命中时间。

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Cache命中时间往往会直接影响到处理器的时钟频率。

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硬件预取通常需要非阻塞cache的支持。

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预取只有在处理器能继续执行其它指令的同时进行才有意义。

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为减少平均访存时间,可以让容量较小的第一级Cache采用较小的块,而让容量较大的第二级Cache采用较大的块。

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评价第二级Cache时,应使用局部失效率这个指标。

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写回法Cache中不必使用写缓冲。

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