填空题
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Verilog HDL的always块语句中的语句是()语句,always块本身却是()语句。
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顺序;并行
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填空题
在Verilog HDL中,使用()关键字说明事件时有输入信号的上述沿触发的;使用()关键字声明事件是由输入信号的下降沿触发的。
参考答案:
posedge;negedge
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在Verilog HDL的if语句中,系统对表达式的值进行判断,若值为0,x或z,则按()处理,若为1,则按()处理。
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假;真
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在Verilog HDL的非阻塞赋值语句中,赋值号是(),赋值变量必须是()型变量。
参考答案:
<=;reg
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在Verilog HDL的阻塞赋值语句中,赋值号”=”左边的赋值变量必须是()型变量。
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reg(寄存器)
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Verilog HDL的连续赋值语句的关键字是(),赋值符号是()。
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assign;=
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在Verilog HDL中register型变量有()、()、()和()4种。
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reg;integer;real;time
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Verilog HDL的register型变量是一种数值容器,不仅可以容纳(),也可以保持(),这一属性与触发器或寄存器的记忆功能有很好的对应关系。
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当前值;历史值
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Verilog HDL的变量分为()和()两种。
参考答案:
网络型(nets type);寄存器型(register type)
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VerilogHDL的条件操作符"?:"的操作数有()个。
参考答案:
3
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在Verilog HDL的"与缩减"运算中,只有操作数中的数字全为()时,结果才为1。
参考答案:
1
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