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问答题

编写一个4位加法计数器VHDL程序的进程(不必写整个结构框架),要求复位信号reset低电平时计数器清零,变高后,在上升沿开始工作;输入时钟信号为clk,输出为q。

参考答案:

问答题

用IF语句编写一个二选一电路,要求输入a、b, sel为选择端,输出q。

参考答案:

填空题

请列举三种可编程逻辑器件:EEPROM、()、FPGA。

参考答案:GAL

问答题

signal标识符合法吗?

参考答案:不合法

问答题

12_bit标识符合法吗?

参考答案:不合法

问答题

digital_ _8标识符合法吗?

参考答案:不合法

问答题

VHDL是否区分大小写?

参考答案:不区分

问答题

完成下图所示的触发器。

参考答案:

问答题

简述moore状态机和mealy状态机的区别。

参考答案:从输出的时序上看,Mealy机的输出是当前状态和所有输入信号的函数,它的输出是在输入变化后立即发生的。Moore机的输出...

问答题

简述如何利用计数器精确控制时序。

参考答案:只要知道晶振频率f,即可知道周期T=1/f;使用一个计数器,可以通过计数值n,精确知道当计数值为n时消耗的时间t=nT;...
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