问答题X 纠错

简述VHDL程序的基本结构。

参考答案：

库 library ieee;
程序包 use ieee std_logic_1164.all;
实体 entity
实体名 is
结构体  architecture
结构体名 of
配置

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若某变量被定义为数值型变量，未赋初始值时默认值为‘0’。

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CONSTANT T2：std_logic <= ’0’;

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参考答案：标准逻辑（std_logic）
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